veriflow-cc
AgentGitHubAktivPython
VeriFlow-CC: A Claude Code-driven RTL design pipeline. Automates Chip-on-Chat from architecture to synthesis (iVerilog/Yosys) using a stateful, zero-dependency LLM orchestration skill. Features sub-agent nesting for code gen and behavioral-driven verification.
Herkunft der Beschreibung: Originalquelle
Gemessen: 20.10.2026 · 68 Beobachtungen
Bereiche & Einsatzzwecke
- Bereiche
- Agenten, Skills und MCP
- Einsatzzwecke
- Workflows
An der Quelle prüfen
Kompatibilität und Voraussetzungen in der offiziellen Dokumentation prüfen.
https://github.com/bjwanneng/veriflow-ccKlassifikationen
- Art
- Werkzeug
Messverlauf
Vergleichbare Messwerte sind nach Signal und Einheit gruppiert.
Sterne
55Sterne · 20.10.2026
+1 (+1,9 %)seit 14.10.2026
Genaue Werte · 7 Messungen
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